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CMOS流水线型ADC研究设计
资料介绍
模数转换器（ADC）作为模拟信号转换为数字信号的桥梁，广泛应用于各种电子系统，是电子系统的关键部分。模数转换器不仅需要有较高的信号处理精度，而且需要有较高的转换速率和功率效率，这些都不断对模数转换器的研究与设计提出新的挑战。
流水线型ADC能够在性能（精度、带宽）和功耗、面积等方面取得很好的折中，成为当前研究及应用的一个热点。基于流水线型ADC典型系统框架，各机构及研究人员演变出了非常多的具体电路结构和实现方案。
依据流水线型ADC的典型系统架构，本文提出了一种10bit流水线型ADC系统实现方案，该方案采用9级流水、无前置SHA架构；单级模数转换单元采用两相不交叠时钟控制两路sub-ADC交替工作，共用余量增益放大器的电路结构。系统整合开关电容电路、余量增益放大电路、全差分结构、离散共模反馈放大电路等一系列CMOS集成电路设计技术。基于FOUNDRIES GLOBAL0.18um CMOS工艺，作者在EDA集成电路设计工具CadenceIC5141平台上实现该系统。在IC5141及Matlab2007b平台上仿真、分析显示，该系统简洁、高效，系统带宽l00MHz以上，有效位数8.8位，功耗仅仅为5.55mW。
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| CMOS流水线型ADC研究设计.pdf | 14M |
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