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Xilinx FPGA Vivado 2014 示例 zynq lab1
资料介绍
Xilinx FPGA权威设计指南——Vivado 2014集成开发环境 配套的工程示例。 基于Xilinx集成开发环境Vivado 2014.3的设计方法、设计流程和具体实现,内容包括:Xilinx UltraScale结构、Vivado集成设计环境导论、Vivado工程模式基本设计实现、Vivado非工程模式基本设计实现、创建和封装用户IP核流程、Vivado高级约束原理及实现、Vivado调试工具原理及实现、Vivado嵌入式系统设计实现、Vivado模型设计原理及实现、Vivado HLS原理及实现、Vivado部分可重配置原理及实现。参考了Xilinx提供的大量Vivado最新设计资料,理论与应用并重,将Xilinx最新的设计理论贯穿在具体的设计实现中。 这是zynq lab1的示例。
部分文件列表
文件名 | 文件大小 | 修改时间 |
Xilinx FPGA Vivado 2014 示例 zynq lab1/lab1.cache/wt/java_command_handlers.wdf | 1KB | 2014-11-24 21:37:44 |
Xilinx FPGA Vivado 2014 示例 zynq lab1/lab1.cache/wt/project.wpc | 1KB | 2014-01-28 20:29:38 |
Xilinx FPGA Vivado 2014 示例 zynq lab1/lab1.cache/wt/webtalk_pa.xml | 1KB | 2014-11-24 21:37:44 |
Xilinx FPGA Vivado 2014 示例 zynq lab1/lab1.hw/hw_1/hw.xml | 1KB | 2014-11-24 20:20:18 |
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Xilinx FPGA Vivado 2014 示例 zynq lab1/lab1.hw/webtalk/usage_statistics_ext_labtool.xml | 3KB | 2014-11-24 20:20:34 |
Xilinx FPGA Vivado 2014 示例 zynq lab1/lab1.sdk/.metadata/.lock | 1KB | 2014-11-06 23:36:06 |
Xilinx FPGA Vivado 2014 示例 zynq lab1/lab1.sdk/.metadata/.log | 73KB | 2014-11-24 21:31:44 |
Xilinx FPGA Vivado 2014 示例 zynq lab1/lab1.sdk/.metadata/.plugins/com.xilinx.sdk.hw.ui/dialog_settings.xml | 1KB | 2014-11-07 00:11:24 |
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资料:bitboy
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