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Xilinx FPGA Vivado 2014 示例 model_design

更新时间：2022-12-04 17:35:46 大小：46M 上传用户：Laspide查看TA发布的资源 标签：xilinxfpgavivado 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

Xilinx FPGA权威设计指南——Vivado 2014集成开发环境 配套的工程示例。 基于Xilinx集成开发环境Vivado 2014.3的设计方法、设计流程和具体实现，内容包括：Xilinx UltraScale结构、Vivado集成设计环境导论、Vivado工程模式基本设计实现、Vivado非工程模式基本设计实现、创建和封装用户IP核流程、Vivado高级约束原理及实现、Vivado调试工具原理及实现、Vivado嵌入式系统设计实现、Vivado模型设计原理及实现、Vivado HLS原理及实现、Vivado部分可重配置原理及实现。参考了Xilinx提供的大量Vivado最新设计资料，理论与应用并重，将Xilinx最新的设计理论贯穿在具体的设计实现中。 这是model_design的示例。

部分文件列表

文件名文件大小修改时间
Xilinx FPGA Vivado 2014 示例 model_design/bandpass_filter/bandpass_filter.slx29KB2014-12-29 11:27:12
Xilinx FPGA Vivado 2014 示例 model_design/bandpass_filter/bandpass_filter_conv.slx37KB2014-02-05 18:42:20
Xilinx FPGA Vivado 2014 示例 model_design/bandpass_filter/bandpass_filter_sysgen_error.log2KB2014-12-29 11:13:52
Xilinx FPGA Vivado 2014 示例 model_design/basic_model/basic_model.slx17KB2014-02-04 19:00:04
Xilinx FPGA Vivado 2014 示例 model_design/basic_model/basic_model_sysgen_error.log1KB2014-02-04 11:37:54
Xilinx FPGA Vivado 2014 示例 model_design/basic_model/netlist/basic_model_gateway_in.dat1KB2014-02-04 13:01:38
Xilinx FPGA Vivado 2014 示例 model_design/basic_model/netlist/basic_model_gateway_out.dat1KB2014-02-04 13:01:38
Xilinx FPGA Vivado 2014 示例 model_design/basic_model/netlist/hdl_netlist/basic_model.data/basic_model_floating_point_v7_0_0/fileset.xml1KB2014-02-04 13:42:26
Xilinx FPGA Vivado 2014 示例 model_design/basic_model/netlist/hdl_netlist/basic_model.data/basic_model_floating_point_v7_0_1/fileset.xml1KB2014-02-04 13:42:26
Xilinx FPGA Vivado 2014 示例 model_design/basic_model/netlist/hdl_netlist/basic_model.data/constrs_1/fileset.xml1KB2014-02-04 13:42:26
Xilinx FPGA Vivado 2014 示例 model_design/basic_model/netlist/hdl_netlist/basic_model.data/runs/basic_model_floating_point_v7_0_0_impl_1.psg1KB2014-02-04 13:26:00
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