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Xilinx FPGA Vivado 2014 示例 fifo_verilog
资料介绍
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文件名 | 文件大小 | 修改时间 |
Xilinx FPGA Vivado 2014 示例 fifo_verilog/fifo_verilog.cache/ip/20745493/20745493.xci | 6KB | 2014-12-01 20:21:34 |
Xilinx FPGA Vivado 2014 示例 fifo_verilog/fifo_verilog.cache/ip/20745493/i_xsdbm.dcp | 119KB | 2014-12-01 20:21:34 |
Xilinx FPGA Vivado 2014 示例 fifo_verilog/fifo_verilog.cache/ip/3136f882/3136f882.xci | 255KB | 2014-12-01 20:25:20 |
Xilinx FPGA Vivado 2014 示例 fifo_verilog/fifo_verilog.cache/ip/3136f882/i_ila.dcp | 789KB | 2014-12-01 20:25:20 |
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Xilinx FPGA Vivado 2014 示例 fifo_verilog/fifo_verilog.cache/wt/synthesis.wdf | 3KB | 2014-12-01 20:10:56 |
Xilinx FPGA Vivado 2014 示例 fifo_verilog/fifo_verilog.cache/wt/webtalk_pa.xml | 4KB | 2014-12-20 22:37:26 |
Xilinx FPGA Vivado 2014 示例 fifo_verilog/fifo_verilog.hw/hw_1/hw.xml | 5KB | 2014-12-20 22:20:38 |
Xilinx FPGA Vivado 2014 示例 fifo_verilog/fifo_verilog.hw/hw_1/wave/hw_ila_data_1/hw_ila_data_1.wcfg | 2KB | 2014-01-27 19:06:36 |
Xilinx FPGA Vivado 2014 示例 fifo_verilog/fifo_verilog.hw/hw_1/wave/hw_ila_data_1/hw_ila_data_1.wdb | 9KB | 2014-12-01 20:47:34 |
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资料:bitboy
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