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[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子

更新时间：2022-11-15 22:35:27 大小：2M 上传用户：Laspide查看TA发布的资源 标签：VerilogHDL电路代码 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

电路图是代码的基础，代码是电路图的描述，这是数字逻辑系统设计的基本思路。遵循这种思路，从电路出发系统地介绍了Verilog语言的知识。介绍了Verilog语言的基础知识以及对应的电路设计技巧，其中重点强调了“看图（电路图）说话（写Verilog代码）”的思想。除了基本知识、可综合语句、仿真验证外，还讲解了复杂系统设计方法，介绍了3种不同算法的DDS系统的设计。通过练习全面地掌握针对工程实践的Verilog语言的知识，并且了解了系统算法与定点化、系统结构与电路设计等概念。 这是“综合例子”章节相关的学习示例。

部分文件列表

文件名文件大小修改时间
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Matlab/DDS_Evaluation.m1KB2016-09-29 13:32:54
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Matlab/DDS_value_one_circle_ROM.txt2KB2016-09-29 13:32:54
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Verilog/Address_Adjust.v2KB2016-09-29 13:32:54
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Verilog/Counter.v2KB2016-09-29 13:32:54
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Verilog/DDS_ROM.bmp1404KB2016-09-29 13:33:22
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Verilog/DDS_ROM.v2KB2016-09-29 13:32:54
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Verilog/DDS_ROM_test.v4KB2016-09-29 13:32:54
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Verilog/DDS_without_ValueTable.v4KB2016-09-29 13:32:54
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Verilog/ipcore_dir/blk_mem_gen_ds512.pdf4451KB2016-09-29 13:33:22
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Verilog/ipcore_dir/blk_mem_gen_v6_2_readme.txt8KB2016-09-29 13:32:54
[源代码]Verilog传奇--从电路出发的HDL代码设计 综合例子/Section 1 DDS_ROM/Verilog/ipcore_dir/coregen.cgp1KB2016-09-29 13:32:54
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