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带有可选展频时钟(SSC)的时钟缓冲器时钟倍乘器
资料介绍
说明 CDCS503-Q1是一款带有可选频率倍乘的可展频、LVCMOS输入时钟缓冲器。 它与CDCS502共用主要的功能性，但是它使用一个LVCMOS输入级而不是CDCS502所使用的晶振输入级，并且CDCS503-Q1有一个输出使能引脚。此器件在输入上接受一个3.3VLVCMOS信号。 这个输入信号由一个锁相环路(PLL)处理，此环路的输出频率或者与输入频率相等或者被乘以因子4。PLL还可通过三角调制将时钟信号以输出时钟频率为中心扩展±0%，±0.5%，±1%或者±2%。这样，此器件可生成介于8MHz和108MHz之间带有或者不带有SSC的输出频率。一个独立的控制引脚可被用于启用或者禁用输出。CDCS503-Q1运行在一个3.3V环境中。器件额定运行温度介于-40°C至105°C之间，并采用8引脚TSSOP封装
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| 带有可选展频时钟(SSC)的时钟缓冲器时钟倍乘器.pdf | 490K |
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