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Quartus II TimeQuest时序分析器说明书
资料介绍
这本手册包含一组设计场景、约束指南以及相关建议。您应该熟悉TimeQuest Timing Analyzer 和Synopsys Design Constraint（SDC）的基础知识，以便正确地使用这些指南。
要了解关于TimeQuest analyzer和SDC的更多信息，请参考www.altera.com/timequest。
时钟和生成的时钟
这一小节显示了各种时钟结构以及如何约束以下结构：
■“基本的非50/50占空比时钟”
■”第1-2页“偏移时钟
■”第1-2页“基本时钟分频器使用-divide by
■”第1-4页“翻转寄存器生成的时钟
■”第1-6页“多频率分析
基本的非50/50占空比时钟
这一小节中介绍的约束是create_clock。
时钟的占空比可以因设计的不同而不同。默认情况下，TimeQuest analyzer中创建的时钟占空比被设置为50/50。然而，您可以使用-waveform选项更改时钟占空比。
图1-1显示了60/40占空比时钟提供时钟的简单的寄存器到寄存器路径。
图1-1.简单的寄存器到寄存器路径
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| QuartusIITimeQuest时序分析器说明书.pdf | 2M |
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2021-11-08 18:30:36401-1
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