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[源代码]数字通信同步技术的MATLAB与FPGA实现 锁相环原理及应用
资料介绍
以Altera公司的FPGA为开发平台，以MATLAB及Verilog HDL为开发工具，详细阐述数字通信同步技术的FPGA实现原理、结构、方法和仿真测试过程，并通过锁相环的工程实例分析FPGA实现过程中的具体技术细节。
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 3 锁相环原理及应用/E3_CloseLoopFreqResponse.m | 1KB | 2012-02-24 18:32:10 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 3 锁相环原理及应用/E3_ErrorFreqResponse.m | 1KB | 2012-02-24 20:39:32 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 3 锁相环原理及应用/E3_TransientResponse.m | 1KB | 2012-02-25 13:25:56 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 3 锁相环原理及应用 | 1KB | 2022-11-06 17:57:06 |
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资料：bitboy
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