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基于冗余抑制的低功耗时序电路设计

更新时间：2020-08-13 05:37:18 大小：108K 上传用户：守着阳光1985查看TA发布的资源 标签：冗余抑制时序电路 下载积分：5分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

针对时序电路中存在的大量冗余时钟信号带来的附加功耗问题,引入基于行为卡诺图的时钟门控逻辑优化技术,对电路中的冗余时钟进行合理封锁,达到降低系统功耗的目的.以六进制同步加法计数器为设计实例,经Multisim进行仿真测试.该方法设计的电路不但有效降低了电路的系统功耗,而且具有更优化的电路结构,证明此设计方法的有效性和优越性.

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