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EDA技术实用教程——VerilogHDL版学习报告
资料介绍
一、EDA技术概述
1.1EDA技术及其发展
20世纪70年代,在集成电路制作方面,双极工艺,MOS工艺已得到广泛的应用:
20世纪80年代,集成电路设计进入了CMOS互补场效应管)时代:
20世纪90年代,集成电路设计工艺进入了超深亚微米阶段:
21世纪,全方面进入了ED时代。
1.2EDA技术实现目标
1.可编程逻辑器件
2.半定制或全定制ASIC
(1)门阵列ASIC
(2)标准单元ASIC
3.混合ASIC
1.3硬件描述语言Verilog HDL
1.VHDL
2.Verilog HDL
3.SystemVerilog 和SystemC
1.4其他常用HDL
VHDL与 Verilog相比,有下列优势:
1.语法比Verilog严谨,通过EDA工具自动语法检查,易排除许多设计中的疏忽:
2.有很好的行为级描述能力和一定的系统级描述能力,而Verilog 建模时,行为与系统级抽象及相关描述能力不及 VHDL与Verilog相比,有下列不足:
1.VHDL代码较冗长,在相同逻辑功能描述时,Verilog的代码比VHD少许多:
2.VHDL对数据类型匹配要求过于严格,初学时会感到不是很方便,编程耗时也较多:
而Verilog 支持自动类型转换,初学者容易入门;
3.VHDL对版图级,管子级这些较为低层的描述级别,几乎不支持,无法直接用于集成电路低层建模。
SystemVerilog主要定位于集成电路的实现和验证流程,并为系统级设计流程提供了强大的链接能力。
System C是C+语言的硬件描述扩展,主要用于ESL(电子系统级)建模与验证。
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