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Cadence 17.4工程示例 16 敷铜

更新时间：2022-12-04 17:07:54 大小：2M 上传用户：Laspide查看TA发布的资源 标签：cadence 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

以Cadence SPB 17.4 PCB开发软件为平台，以具体电路为范例，详尽讲解基于Concept-HDL到Allegro电路板设计的全过程，包括项目管理、元器件原理图符号及元器件封装创建、原理图设计（Concept-HDL）、设计约束、PCB布局与布线的规则、CAM文件输出等电路板设计的全过程，对PCB板级设计有全面的参考和学习价值。 这是敷铜的示例。

部分文件列表

文件名文件大小修改时间
Cadence 17.4工程示例 16 敷铜/CopperPlanes/art_param.txt1KB2005-07-27 14:04:52
Cadence 17.4工程示例 16 敷铜/CopperPlanes/b4cmpln.brd887KB2008-10-14 13:07:34
Cadence 17.4工程示例 16 敷铜/CopperPlanes/Nisland.brd917KB2008-10-14 13:07:34
Cadence 17.4工程示例 16 敷铜/CopperPlanes/solutions/aftrcmpln.brd1012KB2008-10-14 13:07:36
Cadence 17.4工程示例 16 敷铜/CopperPlanes/solutions/art_param.txt1KB2003-12-30 02:08:36
Cadence 17.4工程示例 16 敷铜/CopperPlanes/solutions/b4cmpln.brd883KB2008-10-14 13:07:36
Cadence 17.4工程示例 16 敷铜/CopperPlanes/solutions/completedsplit.brd193KB2008-10-14 13:07:36
Cadence 17.4工程示例 16 敷铜/CopperPlanes/solutions/Nisland.brd917KB2008-10-14 13:07:36
Cadence 17.4工程示例 16 敷铜/CopperPlanes/solutions/split.brd173KB2008-10-14 13:07:38
Cadence 17.4工程示例 16 敷铜/CopperPlanes/solutions/start_shape.brd634KB2008-10-14 13:07:38
Cadence 17.4工程示例 16 敷铜/CopperPlanes/split.brd173KB2008-10-14 13:07:38
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