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通用并行BCH编码器结构探究
资料介绍
本文研究了并行BCH和RS编码电路的通用设计方法和优化结构。针对信息位长度不能整除并行度的问题,采用在信息位前补零,可以不改变并行编码器结构的条件下解决了这个问题。
This paper research into design approach and structural optimization of parallel BCH and RS coding ough padding zero in front of information bits,solve the problem of length of information bits isn’t divisible by degree of parallelism under condition of structure of parallel BCH encoder didn’t be changed.
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