积分商城

最新搜索： STM8 lan9252与stm32的EtherCAT从站实现 HI3559 Keil 雷达 2.4G感应灯电路
您现在的位置是：首页 > 教程 > ​verilog hdl教程135例 VERILOG源码例子
推荐星级：
  • 1
  • 2
  • 3
  • 4
  • 5

​verilog hdl教程135例 VERILOG源码例子

更新时间：2020-12-05 07:58:04 大小：178K 上传用户：xzxbybd查看TA发布的资源 标签：Verilog HDL 下载积分：3分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

verilog hdl教程135例  VERILOG源码例子


【例 3.1】4 位全加器 module adder4(cout,sum,ina,inb,cin); output[3:0] sum; output cout; input[3:0] ina,inb; input cin; assign {cout,sum}=ina+inb+cin; endmodule 【例 3.2】4 位计数器 module count4(out,reset,clk); output[3:0] out; input reset,clk; reg[3:0] out; always @(posedge clk) begin if (reset) out<=0; //同步复位 else out<=out+1; //计数 end endmodule 【例 3.3】4 位全加器的仿真程序 `timescale 1ns/1ns `include "adder4.v" module adder_tp; //测试模块的名字 reg[3:0] a,b; //测试输入信号定义为 reg 型 reg cin; wire[3:0] sum; //测试输出信号定义为 wire 型 wire cout; integer i,j;



image.pngimage.png

部分文件列表

文件名大小
verilog hdl教程135例/
verilog hdl教程135例/_desktop.ini
verilog hdl教程135例/source/
verilog hdl教程135例/source/_desktop.ini
verilog hdl教程135例/source/chap10/
verilog hdl教程135例/source/chap10/_desktop.ini
verilog hdl教程135例/source/chap10/acc.acf
verilog hdl教程135例/source/chap10/acc.hif1KB
verilog hdl教程135例/source/chap10/acc.v1KB
verilog hdl教程135例/source/chap10/accn.v
verilog hdl教程135例/source/chap10/add8.v
...

【关注B站账户领20积分】

相关下载

全部评论(0)

暂无评论
评论赚积分>>

上传资源 上传优质资源有赏金

热门标签

更多>>

最新上传

  • 打赏
  • 30日榜单

热门下载

资料专题

推荐下载

本站上的所有资源均为源于网上收集或者由用户自行上传，仅供学习和研究使用，无任何商业目的，版权归原作如有侵权，请 来信指出，本站将立即改正。

ICP许可证号：京ICP证070360号     21IC电子网 2000- 版权所有

京ICP备11013301号

京公网安备 11010802024343号