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采用verilog实现的有限域GF(28)弱对偶基乘法器设计

更新时间：2020-07-22 15:33:54 大小：14K 上传用户：年轻的国王查看TA发布的资源 标签：verilog乘法器 下载积分：0分 评价赚积分 （如何评价?） 打赏 收藏 评论(1) 举报

资料介绍

采用verilog实现的有限域GF(28)弱对偶基乘法器设计，适合新手学习参考

部分文件列表

文件名文件大小修改时间
RS(204,188)译码器verilog设计/code/BM_KES.v5KB2013-09-29 09:14:14
RS(204,188)译码器verilog设计/code/CheinSearch.v3KB2013-09-29 09:14:14
RS(204,188)译码器verilog设计/code/ff_mul.v5KB2013-09-29 09:14:14
RS(204,188)译码器verilog设计/code/forney.v9KB2013-09-29 09:14:14
RS(204,188)译码器verilog设计/code/ROM_INV.mif3KB2013-09-29 09:14:14
RS(204,188)译码器verilog设计/code/rom_inv.v6KB2013-09-29 09:14:14
RS(204,188)译码器verilog设计/code/rom_power.mif3KB2013-09-29 09:14:14
RS(204,188)译码器verilog设计/code/rom_power.v6KB2013-09-29 09:14:14
RS(204,188)译码器verilog设计/code/RS(204,188)译码器说明.txt1KB2013-09-29 09:14:14
RS(204,188)译码器verilog设计/code/rs_decoder.v2KB2013-09-29 09:14:14
RS(204,188)译码器verilog设计/code/SyndromeCalc.v3KB2013-09-29 09:14:14
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全部评论(1)

  • 2023-02-14 23:04:14杨义

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