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采用verilog语言实现数据的发送与接收设计
资料介绍
采用verilog语言，实现数据的发送与接收设计，适合新手学习参考
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| t1_comm/altpll0.bsf | 4KB | 2014-01-16 14:00:10 |
| t1_comm/altpll0.ppf | 1KB | 2014-01-16 14:00:08 |
| t1_comm/altpll0.qip | 1KB | 2014-01-16 14:00:10 |
| t1_comm/altpll0.v | 16KB | 2014-01-16 14:00:08 |
| t1_comm/altpll0_bb.v | 12KB | 2014-01-16 14:00:10 |
| t1_comm/db/logic_util_heursitic.dat | 1KB | 2014-03-05 20:13:08 |
| t1_comm/db/prev_cmp_t1_comm.qmsg | 46KB | 2014-01-16 15:48:46 |
| t1_comm/db/t1_comm.(0).cnf.cdb | 9KB | 2014-03-05 20:13:08 |
| t1_comm/db/t1_comm.(0).cnf.hdb | 4KB | 2014-03-05 20:13:08 |
| t1_comm/db/t1_comm.(1).cnf.cdb | 6KB | 2014-03-05 20:13:08 |
| t1_comm/db/t1_comm.(1).cnf.hdb | 2KB | 2014-03-05 20:13:08 |
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2023-02-16 22:20:08杨义
内容不错