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采用verilog语言实现数据的发送与接收设计

更新时间：2020-07-21 16:00:11 大小：620K 上传用户：年轻的国王查看TA发布的资源 标签：verilog数据收发 下载积分：0分 评价赚积分 （如何评价?） 打赏 收藏 评论(1) 举报

资料介绍

采用verilog语言，实现数据的发送与接收设计，适合新手学习参考

部分文件列表

文件名文件大小修改时间
t1_comm/altpll0.bsf4KB2014-01-16 14:00:10
t1_comm/altpll0.ppf1KB2014-01-16 14:00:08
t1_comm/altpll0.qip1KB2014-01-16 14:00:10
t1_comm/altpll0.v16KB2014-01-16 14:00:08
t1_comm/altpll0_bb.v12KB2014-01-16 14:00:10
t1_comm/db/logic_util_heursitic.dat1KB2014-03-05 20:13:08
t1_comm/db/prev_cmp_t1_comm.qmsg46KB2014-01-16 15:48:46
t1_comm/db/t1_comm.(0).cnf.cdb9KB2014-03-05 20:13:08
t1_comm/db/t1_comm.(0).cnf.hdb4KB2014-03-05 20:13:08
t1_comm/db/t1_comm.(1).cnf.cdb6KB2014-03-05 20:13:08
t1_comm/db/t1_comm.(1).cnf.hdb2KB2014-03-05 20:13:08
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全部评论(1)

  • 2023-02-16 22:20:08杨义

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