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用Verilog写的cordic相位鉴别采用8级的流水线的硬件设计
资料介绍
用Verilog写的cordic相位鉴别，采用8级的流水线的硬件设计，适合感兴趣的学习者学习，可以提高自己的能力，大家可以多交流哈
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| 文件名 | 文件大小 | 修改时间 |
| cordic.v | 5KB | 2010-10-09 17:25:38 |
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资料：bitboy
全部评论(2)
2023-04-20 21:32:38杨义
感谢分享
2020-05-05 14:33:47suxindg
谢谢分享