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用Verilog写的cordic相位鉴别采用8级的流水线的硬件设计

更新时间：2020-04-30 13:37:26 大小：1K 上传用户：年轻的国王查看TA发布的资源 标签：verilog 下载积分：0分 评价赚积分 （如何评价?） 打赏 收藏 评论(2) 举报

资料介绍

用Verilog写的cordic相位鉴别，采用8级的流水线的硬件设计，适合感兴趣的学习者学习，可以提高自己的能力，大家可以多交流哈



部分文件列表

文件名文件大小修改时间
cordic.v5KB2010-10-09 17:25:38

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全部评论(2)

  • 2023-04-20 21:32:38杨义

    感谢分享

  • 2020-05-05 14:33:47suxindg

    谢谢分享

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