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利用Verilog设计的16位CPU的设计案例

更新时间：2020-04-30 13:35:32 大小：860K 上传用户：年轻的国王查看TA发布的资源 标签：verilogcpu 下载积分：0分 评价赚积分 （如何评价?） 打赏 收藏 评论(2) 举报

资料介绍

利用Verilog设计的16位CPU的设计案例，适合感兴趣的学习者学习，可以提高自己的能力，大家可以多交流哈



部分文件列表

文件名文件大小修改时间
16位CPU的verilog代码/cpu/CPU.v5KB2008-01-24 15:34:10
16位CPU的verilog代码/cpu/decoder.v1KB2008-01-23 20:57:38
16位CPU的verilog代码/cpu/ram.v1KB2008-01-24 08:18:48
16位CPU的verilog代码/cpu/RISC_CPU设计练习.doc810KB2005-10-26 09:02:46
16位CPU的verilog代码/cpu/rom.v1KB2008-01-24 09:36:18
16位CPU的verilog代码/cpu/test.v8KB2008-01-27 22:57:06
16位CPU的verilog代码/cpu/test1.dat1KB2008-01-23 11:03:16
16位CPU的verilog代码/cpu/test1.pro3KB2008-01-23 21:04:38
16位CPU的verilog代码/cpu/test2.dat1KB2008-01-23 11:17:36
16位CPU的verilog代码/cpu/test2.pro2KB2008-01-23 21:05:14
16位CPU的verilog代码/cpu/test3.dat1KB2008-01-23 12:18:16
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全部评论(2)

  • 2023-04-21 22:10:09杨义

    内容还行

  • 2020-05-06 13:28:10suxindg

    谢谢分享

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