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一个倍频率器 verilog硬件描述语言写的
资料介绍
一个倍频器，使用verilog硬件描述语言写的，在vivado上可以综合成功，希望采纳
部分文件列表
| 文件名 | 大小 |
| signal/ | |
| signal/db/ | |
| signal/db/logic_util_heursitic.dat | 1KB |
| signal/db/pll2_altpll.v | 4KB |
| signal/db/plll_altpll.v | 4KB |
| signal/db/pll_altpll.v | 4KB |
| signal/db/prev_cmp_test1.qmsg | |
| signal/db/test1.(0).cnf.cdb | 1KB |
| signal/db/test1.(0).cnf.hdb | 1KB |
| signal/db/test1.(1).cnf.cdb | 2KB |
| signal/db/test1.(1).cnf.hdb | 1KB |
| ... | |
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