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FPGA VHDL实现 时钟分频一秒 fpga
资料介绍
FPGA VHDL实现 时钟分频一秒 fpga,适合感兴趣的学习者学习,可以提高自己的能力,大家可以多交流哈
部分文件列表
文件名 | 文件大小 | 修改时间 |
18实验十八:时钟分频1秒/db/div_f.(0).cnf.cdb | 2KB | 2010-04-14 22:45:48 |
18实验十八:时钟分频1秒/db/div_f.(0).cnf.hdb | 1KB | 2010-04-14 22:45:48 |
18实验十八:时钟分频1秒/db/div_f.asm.qmsg | 2KB | 2010-04-14 22:45:56 |
18实验十八:时钟分频1秒/db/div_f.asm_labs.ddb | 4KB | 2010-04-14 22:45:56 |
18实验十八:时钟分频1秒/db/div_f.cbx.xml | 1KB | 2010-04-14 22:45:48 |
18实验十八:时钟分频1秒/db/div_f.cmp.bpm | 1KB | 2010-04-14 22:45:52 |
18实验十八:时钟分频1秒/db/div_f.cmp.cdb | 9KB | 2010-04-14 22:45:58 |
18实验十八:时钟分频1秒/db/div_f.cmp.ecobp | 1KB | 2010-04-14 22:45:52 |
18实验十八:时钟分频1秒/db/div_f.cmp.hdb | 7KB | 2010-04-14 22:45:58 |
18实验十八:时钟分频1秒/db/div_f.cmp.kpt | 1KB | 2010-04-14 22:45:52 |
18实验十八:时钟分频1秒/db/div_f.cmp.logdb | 1KB | 2010-04-14 22:45:52 |
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