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基于FPGA设计串口传输的简易数据流检测器设计及功能验证 课设报告+Verilog源代码.zip
资料介绍
基于FPGA设计串口传输的简易数据流检测器设计及功能验证-课设报告+Verilog源代码.zip
部分文件列表
| 文件名 | 大小 |
| prj/ | |
| prj/c5_pin_model_dump.txt | 5KB |
| prj/db/ | |
| prj/db/.cmp.kpt | 1KB |
| prj/db/a_dpfifo_pa21.tdf | 3KB |
| prj/db/a_fefifo_18e.tdf | 4KB |
| prj/db/altsyncram_q3k1.tdf | |
| prj/db/cntr_3ob.tdf | 4KB |
| prj/db/cntr_fo7.tdf | 4KB |
| prj/db/dpram_j811.tdf | 2KB |
| prj/db/jiance_ce_10010.(0).cnf.cdb | 4KB |
| ... | |
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