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芯片内互连技术概述
资料介绍
芯片内互连（On-Chip Interconnect）是集成电路（IC）中连接各个功能模块的关键基础设施，负责在处理器核心、缓存、I/O接口、专用加速器等组件之间传输数据和控制信号。随着半导体工艺进入纳米级，芯片复杂度呈指数级增长，互连延迟、功耗和带宽已成为制约芯片性能的核心瓶颈，其设计质量直接影响芯片的整体性能、能效和可靠性。
一、芯片内互连的基本结构
1.1 物理层组成
互连物理层由金属导线、通孔（Via）和接触孔（Contact）构成，通常采用多层金属布线结构。低层金属（如M1-M3）线宽较窄、间距小，适用于局部互连；高层金属（如M4-M8）线宽更大、电阻更低，用于长距离全局互连。铜（Cu）因低电阻率成为主流互连材料，配合低介电常数（Low-k）介质减少寄生电容。
1.2 拓扑结构
· 总线（Bus）：早期芯片的主流结构，如地址总线、数据总线和控制总线，通过共享传输介质实现多模块通信。优点是结构简单，缺点是带宽受限、存在总线竞争。
· 交叉开关（Crossbar Switch）：通过矩阵式开关阵列实现任意端口间的直接连接，支持并行数据传输，适用于中小规模模块互连（如CPU与缓存之间）。
· 片上网络（Network-on-Chip, NoC）：针对多核/众核芯片设计的分布式互连架构，借鉴计算机网络思想，将模块抽象为节点，通过路由器和物理链路形成网络。常见拓扑包括网格（Mesh）、环形（Ring）、树形（Tree）和胖树（Fat-Tree）等，可灵活扩展带宽和节点数量。
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