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简单流水线CPU使用 verilog实现实现一条指令的整个流程
资料介绍
简单流水线CPU，使用 verilog实现，实现一条指令的整个流程，适合感兴趣的学习者学习，可以提高自己的能力，大家可以多交流哈
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| new/defines.v | 3KB | 2014-02-24 10:53:56 |
| new/ex.v | 5KB | 2014-02-24 10:54:38 |
| new/ex_mem.v | 3KB | 2014-02-24 10:43:38 |
| new/hilo_reg.v | 2KB | 2019-07-15 14:38:54 |
| new/id.v | 10KB | 2019-07-15 14:14:06 |
| new/id_ex.v | 3KB | 2014-02-20 19:22:10 |
| new/if_id.v | 2KB | 2014-02-20 18:11:34 |
| new/inst_rom.data | 1KB | 2014-02-25 13:36:52 |
| new/inst_rom.v | 2KB | 2014-03-30 11:26:46 |
| new/mem.v | 3KB | 2014-02-24 10:45:40 |
| new/mem_wb.v | 3KB | 2014-02-24 10:46:32 |
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2023-05-12 21:11:46杨义
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