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基于FPGA的1位D触发器的设计
资料介绍
基于FPGA的1位D触发器的设计,适合新手学习参考
部分文件列表
| 文件名 | 大小 |
| VHDL-book3/ | |
| VHDL-book3/clock_pluse/ | |
| VHDL-book3/clock_pluse/clock_pluse.cmd_log | 1KB |
| VHDL-book3/clock_pluse/clock_pluse.ise | |
| VHDL-book3/clock_pluse/clock_pluse.lso | |
| VHDL-book3/clock_pluse/clock_pluse.ngc | 1KB |
| VHDL-book3/clock_pluse/clock_pluse.ngr | 1KB |
| VHDL-book3/clock_pluse/clock_pluse.ntrc_log | |
| VHDL-book3/clock_pluse/clock_pluse.prj | |
| VHDL-book3/clock_pluse/clock_pluse.restore | |
| VHDL-book3/clock_pluse/clock_pluse.stx | |
| ... | |
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全部评论(1)
2023-02-07 21:26:17杨义
内容还行