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基于Verilog的VGA显示控制
资料介绍
一、VGA时序
下面的图是本人画了一个晚上的结果，个人认为能够比较详细的阐述VGA的信号时序。
VGA的时序根据不同的显示分辨率和刷新频率会有变化，具体各种类型的时序信息可以参考下面的网站，这里非常详细的说明的每一种显示模式的VGA时序信息。
二、VGA电平
VSYNC，HSYNC为标准TTL电平，0V3.3V RGB的电平在0V0.7V之间（0V为黑色，0.7V为全色）
三、程序顶层框图
VGA产生行同步（HSYNC），场同步信号（VSYNC），并产生每个像素的地址输入单口ROM（显存）中，ROM输出该点需要显示的颜色值。
四、单口ROM（显存）设计
程序的显示模式为800*600，72H12刷新频率，像素频率为50MHz2每个像素需要显示的颜色存储在单口RAM中，每种颜色用8个字节表示，则如果要显示800*600分辨率，则需要800*600字节（480KB）的单口ROM，由于FPGA内部没有这么大的RAM（我用的是ep2c8），因此我把屏幕上100*100个像素组成的矩形作为一个逻辑像素（即显示同一种颜色），这样只要86字节（48节），用F PGA自带的RAM是很容易实现的。
ROM中颜色存储地址表
将全屏划分成8*6的方格，每个方格的颜色存储在ROM中，VGA控制器不断产生行坐标（ROM水平地址）和场坐标（ROM垂直地址），最后组合成ROM实际地址输入ROM中，ROM输出该地址的颜色值，显示在LCD中。
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| 文件名 | 大小 |
| 基于Verilog的VGA显示控制.pdf | 778K |
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