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PCB布线专项审查SI与PI核查点.docx
资料介绍
PCB布线专项审查：SI/PI关键核查点
布线完成不是终点，审查才算过关
很多工程师布线完成后，只检查有没有开路短路，就急着发板。可等到样板上电调试，信号抖动、DDR读写不稳定、EMC测试不过关，才追悔莫及。布线阶段忽略的参考平面、回流路径、差分等长、过孔规范，都在后面"等着算账"。这篇文章把布线专项审查的关键核查点整理成一份实用清单，帮你在发板前把高速设计的隐患排查干净。
高速差分走线审查
差分信号广泛应用于USB、以太网、HDMI、PCIe、DDR，是布线审查优先级最高的板块。四个核查方向：
对内长度误差
查阅设计规范允许的对内长度偏差，逐条测量差分两线长度，超公差的标记整改。长度不匹配会造成相位偏移、共模噪声增大、高速接口丢包。
耦合间距一致性
差分两线全程平行、间距恒定，中途别忽宽忽窄、别借过孔强行拉开间距。拆分开后尽快重新耦合，拆分距离越短越好。
参考平面完整性
差分走线下方对应地层不能分割开槽。跨分割地，差分信号回流路径被迫绕远，环路面积增大、辐射和损耗上升。
过孔规范
差分对两线过孔数量一致，减少时延差。高速差分尽量减少过孔。
时钟与高速单端走线审查
时钟走线
时钟是重要干扰源，走线回路面积要最小、紧贴完整地平面、不跨电源地分割、远离敏感信号、旁边禁止平行长走线。
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| PCB布线专项审查SI与PI核查点.docx | 38K |
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