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静态时序工具在DDR Memory接口时序收敛和后仿真中的应用
资料介绍
为提高带宽,很多类型的Memory都采用了Double Data Rate(DDR)interface,它对在内存控制器(memory controller)设计过程中的时序收敛和后仿真提出了挑战。探讨利用静态时序分析工具解决这个问题的方法。
Double Data Rate(DDR)interface is a trend of memory interface these years.It presents some challenges for timing closure and post-SDF simulation when designing memory controller as long as the bus width is extended and speed is pushed to higher.This paper will discuss one practice to handle it with static Timing analysis(STA)tool.
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