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美光DDR3存储器模型，用Verilog语言编写，通用模型

更新时间：2019-10-22 17:39:25 大小：41K 上传用户：lalahug查看TA发布的资源 标签：ddr3存储器verilog 下载积分：5分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

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美光DDR3存储器模型，用Verilog语言编写，通用模型

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部分文件列表

文件名文件大小修改时间
2048Mb_ddr3/ddr3.v146KB2009-12-11 11:08:52
2048Mb_ddr3/ddr3_mcp.v3KB2009-05-26 16:28:30
2048Mb_ddr3/ddr3_module.v32KB2009-05-26 16:29:02
2048Mb_ddr3/readme.txt9KB2009-05-26 16:28:34
2048Mb_ddr3/subtest.vh13KB2009-11-12 15:46:12
2048Mb_ddr3/tb.do2KB2009-05-26 16:29:04
2048Mb_ddr3/tb.v19KB2009-11-12 15:46:12
2048Mb_ddr3/ddr3_parameters.vh75KB2010-01-08 09:41:30
2048Mb_ddr31KB2010-12-20 20:57:18

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