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[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析
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文件名 | 文件大小 | 修改时间 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/crc32_8023.v | 4KB | 2021-03-28 10:56:26 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/crc_test.v | 2KB | 2021-03-28 10:56:10 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/mac_loopback.v | 3KB | 2021-03-28 11:03:20 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/mac_r.v | 5KB | 2021-03-28 10:55:34 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/mac_r_tb_v1.v | 4KB | 2021-03-28 10:59:16 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/mac_r_tb_v2.v | 4KB | 2021-03-28 11:00:22 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/mac_t.v | 8KB | 2021-03-28 11:01:00 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/mac_top.v | 1KB | 2021-03-28 13:52:16 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/mac_top_test.v | 1KB | 2021-03-28 11:08:42 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/mac_top_test_tb.v | 4KB | 2021-03-28 11:05:32 |
[源代码]Verilog HDL数字系统设计与验证--以太网交换机案例分析/2 MAC控制器的设计/mac_t_tb.v | 2KB | 2021-03-28 11:01:54 |
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资料:bitboy
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