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Verilog编写的SDRAM读写程序运行166MHZ

更新时间：2020-03-31 12:01:20 大小：4M 上传用户：史艳高查看TA发布的资源 标签：verilogsdram 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

基于XC6LS16的verilog代码，用于驱动SDRAM，运行速率144MHZ

部分文件列表

文件名文件大小修改时间
s6_sdram_166MHz/s6_sdram/fuse.log3KB2019-09-03 16:57:42
s6_sdram_166MHz/s6_sdram/fuse.xmsgs1KB2019-09-03 16:57:42
s6_sdram_166MHz/s6_sdram/fuseRelaunch.cmd1KB2019-09-03 16:57:38
s6_sdram_166MHz/s6_sdram/ipcore_dir/asfifo_wr256x16_rd256x16/doc/fifo_generator_v9_3_readme.txt10KB2019-08-31 10:28:52
s6_sdram_166MHz/s6_sdram/ipcore_dir/asfifo_wr256x16_rd256x16/doc/fifo_generator_v9_3_vinfo.html10KB2019-08-31 10:28:52
s6_sdram_166MHz/s6_sdram/ipcore_dir/asfifo_wr256x16_rd256x16/doc/pg057-fifo-generator.pdf74KB2019-08-31 10:28:52
s6_sdram_166MHz/s6_sdram/ipcore_dir/asfifo_wr256x16_rd256x16/example_design/asfifo_wr256x16_rd256x16_exdes.ucf3KB2019-08-31 10:27:40
s6_sdram_166MHz/s6_sdram/ipcore_dir/asfifo_wr256x16_rd256x16/example_design/asfifo_wr256x16_rd256x16_exdes.vhd5KB2019-08-31 10:27:40
s6_sdram_166MHz/s6_sdram/ipcore_dir/asfifo_wr256x16_rd256x16/fifo_generator_v9_3_readme.txt10KB2013-10-14 02:04:38
s6_sdram_166MHz/s6_sdram/ipcore_dir/asfifo_wr256x16_rd256x16/implement/implement.bat3KB2019-08-31 10:27:40
s6_sdram_166MHz/s6_sdram/ipcore_dir/asfifo_wr256x16_rd256x16/implement/implement.sh3KB2019-08-31 10:27:40
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