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FPGA布线教程
资料介绍
在FPGA中实现电路所需的整个CAD过程(来自设计的RTL描述)包括以下步骤:
逻辑优化。执行布尔方程的两级或多级最小化以优化面积,延迟或两者的组合。
技术映射。将布尔方程转换为FPGA逻辑块的电路。此步骤还优化了所需逻辑块的总数(区域优化)或时间关键路径中的逻辑块数(延迟优化)。
放置。选择FPGA中每个逻辑块的特定位置,同时尽量减少所需的互连总长度。
布线。连接可用的FPGA路由资源
通过布局工具将逻辑块分布在FPGA内部,将信号从生成位置传送到使用它们的位置。
路由是该过程的一个重要步骤,因为大多数FPGA领域都致力于互连[21],并且互连延迟大于设计电路的逻辑延迟。因此,有效的路由算法试图减少总布线面积和关键路径网络的长度,以改善电路的性能;为此,路由器需要目标FPGA架构的互连信息。这意味着路由问题取决于体系结构,因此路由FGPA所需的路由器数量与市场上的FPGA架构一样多样。
部分文件列表
| 文件名 | 大小 |
| Routing.pdf | 426K |
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