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一种应用于rfid读写器中发射机的10位低功耗dac的分析与设计
资料介绍
本文在局部的电路结构方面，采用新的方法对面积和功耗做出了优化。
模拟电路部分的降低功耗的最有效手段是降低单位电流的大小，而由于受到与失配程度相关的MOS管栅区面积的限制，以及特定工艺对MOS管尺寸的限制，单位电流无法做得很低。本文在此提出了一种半单位电流结构，使得在不影响MOS失配程度和不违反工艺尺寸限制的情况下，将单位电流大小再减小一半，这就意味着电流源阵列的功耗和面积都再下降一半。
数字电路部分的降低功耗的一种方法是降低译码电路的复杂度。本文采用传统温度计码和伪译码相结合的译码结构，既利用了温度计码理想的单调翻转特性，使高3位达到理想的线性度，从而保证了DAC整体的线性度，又利用了伪译码的简易性，使低3位译码电路得到简化。最终得到的组合译码器的逻辑门数比传统3-3行列温度计译码器的逻辑门数减少35%，使面积和功耗得到优化。
最后借助 spectre仿真器和Matlab的数据处理功能，对本设计的CSDAC做了整体仿真，得到在输出信号带宽为4MHz时的DNL和INL.都小于0.5LSB，SFDR为69dB，SNDR为64dB，都满足设计指标，并且总体消耗的电流为2.95mA，满足了低功耗设计的要求。
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