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在FPGA上实现MATLAB和Simulink的算法
资料介绍
HDL 代码产生和验证
代码产生
– 可读的VHDL 或 Verilog
– 为主频和资源进行优化的多种选项
验证
– 产生RTL测试平台
– 与ModelSim 或 Incisive联合仿真
设计自动化
– 集成了 Xilinx 或 Altera 的综合工具
– 可对主频和资源进一步优化
– 支持很多Xilinx and Altera 的开发板卡
怎样用Simulink搭建和仿真你的算法
• 怎样迅速产生HDL代码
• 代码可读性如何
• 怎样迅速把代码综合到Xilinx的芯片上
• 怎样提高代码的效率
部分文件列表
| 文件名 | 大小 |
| programmable-soc-design-using-matlab-simulink-part-1.pdf | 1M |
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