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性能监控单元（PMU）详解.doc
资料介绍
性能监控单元（PMU）
什么是性能监控单元（PMU）
性能监控单元（Performance Monitoring Unit，简称PMU）是集成在现代CPU、GPU以及部分SoC芯片中的硬件模块，主要功能是对处理器运行过程中的各类硬件事件进行计数、采样与统计，帮助开发者或系统管理人员获取芯片运行的真实性能数据，定位性能瓶颈，优化软件与硬件资源配置。
不同于软件层面的性能监控工具，PMU是硬件原生实现的功能，它对系统运行的干扰极低，能够获得最接近真实运行状态的性能数据，是性能分析领域最核心的底层数据来源之一。
PMU的核心功能
1. 硬件事件计数：PMU可以对预设的硬件事件进行累加计数，常见支持的事件包括：指令数、时钟周期数、缓存命中/缺失次数、分支预测失败次数、总线访问次数、功耗相关事件等。通过不同事件的计数值，可以计算出平均指令周期（CPI）、缓存命中率、分支预测成功率等核心性能指标。
2. 事件采样：PMU支持基于事件触发的采样功能，当指定硬件事件的计数达到预设阈值时，PMU会触发中断，记录当前程序的执行位置（程序指针），帮助开发者定位程序中频繁产生特定事件的代码位置，常用于查找缓存命中率低、指令发射阻塞等问题。
3. 性能中断与溢出处理：当PMU的计数器溢出时，可以触发内核中断，内核可以在中断处理中记录溢出次数，实现长时间运行下的大计数统计，同时也可以基于溢出触发采样逻辑。
4. 多核心/多线程监控：现代多核处理器中，每个核心通常都拥有独立的PMU模块，可以分别监控每个核心、每个硬件线程的运行状态，也支持对整体芯片的全局性能事件进行汇总统计。
PMU的基本架构
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