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verilog乘法器

更新时间:2015-09-25 14:20:29 大小:1K 上传用户:nakedde查看TA发布的资源 标签:verilog16位乘法器 下载积分:2分 评价赚积分 (如何评价?) 打赏 收藏 评论(0) 举报

资料介绍

使用verilog进行编程,实现16位的乘法器功能。在quartus ii编译环境下测试,使用modelsim仿真软件仿真。

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