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[源代码]数字通信同步技术的MATLAB与FPGA实现 数字锁相法位同步技术的FPGA实现
资料介绍
以Altera公司的FPGA为开发平台,以MATLAB及Verilog HDL为开发工具,详细阐述数字通信同步技术的FPGA实现原理、结构、方法和仿真测试过程,并通过数字锁相法的工程实例分析FPGA实现过程中的具体技术细节。
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文件名 | 文件大小 | 修改时间 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/clock.ppf | 1KB | 2019-05-05 09:11:04 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/clock.qip | 1KB | 2019-05-05 09:11:04 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/clock.v | 14KB | 2019-05-05 09:11:04 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/clock_bb.v | 11KB | 2019-05-05 09:11:04 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/cos.bsf | 2KB | 2014-09-24 21:05:08 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/cos.html | 4KB | 2014-09-24 21:05:24 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/cos.qip | 14KB | 2014-09-24 21:05:20 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/cos.v | 11KB | 2014-09-24 21:05:24 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/cos.vec | 1KB | 2014-09-24 21:05:00 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/cos.vo | 75KB | 2014-09-24 21:05:16 |
[源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 7 数字锁相法位同步技术的FPGA实现/DifBitSync_BoardTst/cos_bb.v | 2KB | 2014-09-24 21:05:02 |
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资料:STM32控制小米电机
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