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FSK解调Verilog的实现及仿真-精品文档
资料介绍
Verilog HDL语言是硬件描述语言之一,常用的硬件描述语言有VHDL和Verilog,在欧美国家VHDL的使用要大于Verilog,而在中国Verilog 所占份额要大于VHDLVerilog 语言与C语言非常相似,可以说是基于C语言的结构而发展起来的,VHD语言的格式没有Verilog通俗易懂,但是VHDL更接近硬件,综合起来要优于Verilog。可以说Verilog和VHDL各有所长[1]。早期的集成电路模板是工程师根据电路原理图手工绘制的,由于早期的电路简单,所以这种手工绘制的方法暂时可以满足需求,但是随着集成电路的集成度和复杂度的增加,手工绘制越来越不能满足设计的需要,并且时常会出现一些错误。这样硬件描述语言就应运而生,早期硬件描述语言只是起到仿真和验证的作用,随着运用越来越广泛和后期添加功能,Verilog 逐渐被设计者使用。
到了今天,硬件描述语言Verilog已经广泛的运用于大规模、超大规模集成电路的设计。电子设计自动化也越来越不能离开硬件描述语言,并且衍生出新的语言比如:SystemVerilog。
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