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基于FPGA的PWM仿真 verilog源码
资料介绍
1、设计一个多路伺服控制器IP,能够工作在128Khz至100Mhz不同时钟频率下;
2、PWM信号固定周期为20ms;
3、占空比可通过8位输入信号duty调节,duty为0时占空比0.5ms,duty为255时占空比为2.5ms;
4、多路控制器输出通道数目可选,各通道的控制通过地址线选择;
5、设计testbench,在Modelsim中对设计进行仿真验证;
6、将设计下载下DE1开发板上进行硬件验证;
部分文件列表
文件名 | 大小 |
基于FPGA的PWM仿真/ | |
基于FPGA的PWM仿真/mult_servo_controller/ | |
基于FPGA的PWM仿真/mult_servo_controller/c5_pin_model_dump.txt | 5KB |
基于FPGA的PWM仿真/mult_servo_controller/db/ | |
基于FPGA的PWM仿真/mult_servo_controller/db/.cmp.kpt | 2KB |
基于FPGA的PWM仿真/mult_servo_controller/db/altsyncram_cm14.tdf | |
基于FPGA的PWM仿真/mult_servo_controller/db/altsyncram_gk84.tdf | |
基于FPGA的PWM仿真/mult_servo_controller/db/altsyncram_ko14.tdf | |
基于FPGA的PWM仿真/mult_servo_controller/db/altsyncram_ml14.tdf | |
基于FPGA的PWM仿真/mult_servo_controller/db/altsyncram_mo14.tdf | |
基于FPGA的PWM仿真/mult_servo_controller/db/cmpr_99c.tdf | 2KB |
... |
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资料:bitboy
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