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FPGA代码verilog，其中包含多个常用的代码程序
资料介绍
FPGA代码verilog，其中包含多个常用的代码程序
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| code/cpu_interface/cpu_inface_tb.v | 1KB | 2009-08-01 14:55:58 |
| code/cpu_interface/cpu_interface.v | 3KB | 2009-08-01 15:02:36 |
| code/FIFO/同步FIFO/FIFO设计程序/FIFO.doc | 19KB | 2005-06-10 00:00:58 |
| code/FIFO/同步FIFO/FIFO设计程序/fifo.v | 4KB | 2005-06-09 23:22:44 |
| code/FIFO/同步FIFO/FIFO设计程序/fifotb.v | 3KB | 2005-06-09 23:14:54 |
| code/FIFO/同步FIFO/FIFO设计程序/~$FIFO.doc | 1KB | 2009-07-12 10:10:30 |
| code/FIFO/异步FIFO/fifo_asyn.v | 3KB | 2009-07-13 13:34:08 |
| code/sent_receive_code/clkfp.v | 1KB | 2009-07-26 14:22:54 |
| code/sent_receive_code/dividor.v | 1KB | 2009-07-26 15:36:14 |
| code/sent_receive_code/pnpro.v | 1KB | 2009-07-26 15:41:02 |
| code/sent_receive_code/pnsend.v | 1KB | 2009-07-26 15:40:50 |
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