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动态逻辑电路

更新时间：2026-05-28 20:03:55 大小：18K 上传用户：潇潇江南查看TA发布的资源 标签：逻辑电路 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

一、基本概念

动态逻辑电路是一种基于 MOS 管电容效应和电荷存储原理实现逻辑功能的数字集成电路。与静态逻辑电路（如 CMOS 反相器、与非门等）相比，其显著特点是利用晶体管的栅极电容或寄生电容作为临时存储单元，通过电荷的积累与释放来表示逻辑状态，从而减少电路中的晶体管数量，提高集成度和工作速度。

动态逻辑电路的核心工作原理依赖于两个关键阶段：预充电阶段和求值阶段。在预充电阶段，电路中的电容被充电至特定电压（通常为电源电压 VDD）；在求值阶段，根据输入信号的组合，电容上的电荷可能通过放电通路释放，从而输出相应的逻辑电平。

二、基本结构与工作原理

（一）动态反相器

动态反相器是动态逻辑电路的基础，其典型结构由以下部分组成：

· 预充电管（PMOS）：由时钟信号 φ 控制，在预充电阶段（φ=0）导通，将输出节点 OUT 连接至 VDD，对输出电容 CL（包括负载电容和寄生电容）充电至 VDD。

· 求值管（NMOS）：由输入信号 A 控制，在求值阶段（φ=1）根据输入信号状态决定是否导通。若 A=1，NMOS 导通，输出节点 OUT 通过 NMOS 放电至 GND；若 A=0，NMOS 截止，输出节点保持预充电状态（VDD）。

· 输出电容 CL：用于存储电荷，维持输出状态。

工作波形如下：

· φ=0（预充电）：PMOS 导通，OUT 被充电至 VDD；NMOS 因 φ=0 截止（若求值管由 φ 控制），输入 A 不影响输出。

· φ=1（求值）：PMOS 截止，NMOS 根据输入 A 导通或截止。若 A=1，OUT 放电至 GND；若 A=0，OUT 保持 VDD。


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