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Altera IP核8B10B编码器的完整设计流程包括Altera IP的定制、仿真和实现的全过程
资料介绍
Altera IP核8B10B编码器的完整设计流程包括Altera IP的定制、仿真和实现的全过程
部分文件列表
文件名 | 文件大小 | 修改时间 |
Ateral IP/Project/Simulation/220model.v | 157KB | 2004-09-10 10:17:58 |
Ateral IP/Project/Simulation/altera_mf.v | 1228KB | 2004-09-10 10:08:12 |
Ateral IP/Project/Simulation/sgate.v | 26KB | 2004-09-10 10:18:14 |
Ateral IP/Project/Simulation/sim.do | 1KB | 2004-10-25 22:32:34 |
Ateral IP/Project/Simulation/wave.do | 1KB | 2004-10-25 22:29:36 |
Ateral IP/Solution/ENC.bsf | 4KB | 2004-10-25 22:08:38 |
Ateral IP/Solution/ENC.v | 8KB | 2004-10-25 22:08:54 |
Ateral IP/Solution/ENC_aot1151_enc8b10b.v | 29KB | 2004-10-25 22:08:40 |
Ateral IP/Solution/IP_ENC/ENC.bsf | 4KB | 2004-10-25 22:08:38 |
Ateral IP/Solution/IP_ENC/ENC.cmp | 2KB | 2004-10-25 22:08:38 |
Ateral IP/Solution/IP_ENC/ENC.html | 4KB | 2004-10-25 22:08:54 |
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