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FPGA UART Verilog

更新时间：2016-02-22 14:23:01 大小：5M 上传用户：braveheart081查看TA发布的资源 标签：UARTVerilog 下载积分：4分 评价赚积分 （如何评价?） 打赏 收藏 评论(1) 举报

资料介绍

三段式状态机，UART接口实现，已经通过验证，可以正确收发数据

部分文件列表

文件名文件大小修改时间
UART/db/logic_util_heursitic.dat9KB2016-01-25 22:45:02
UART/db/prev_cmp_UART.qmsg38KB2016-01-25 22:45:00
UART/db/UART.(0).cnf.cdb1KB2016-01-25 22:04:26
UART/db/UART.(0).cnf.hdb1KB2016-01-25 22:04:26
UART/db/UART.(1).cnf.cdb8KB2016-01-25 22:43:02
UART/db/UART.(1).cnf.hdb2KB2016-01-25 22:43:02
UART/db/UART.(2).cnf.cdb3KB2016-01-25 22:44:00
UART/db/UART.(2).cnf.hdb1KB2016-01-25 22:44:00
UART/db/UART.amm.cdb1KB2016-01-25 22:45:02
UART/db/UART.asm.qmsg2KB2016-01-25 22:45:04
UART/db/UART.asm.rdb1KB2016-01-25 22:45:04
...

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全部评论(1)

  • 2016-05-08 21:47:52bitshiyan

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