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资料介绍

静态时序分析PrimeTime与时序收敛方法

一、引言

静态时序分析是芯片设计中最关键的签核环节之一,验证芯片在所有工作条件下都能满足时序约束。Synopsys PrimeTime是业界标准的静态时序分析工具,被广泛应用于从RTLGDS的完整设计流程中。时序收敛是芯片设计的核心挑战,在先进工艺节点中,时序收敛的难度呈指数级增长。

二、静态时序分析的基本原理

2.1 时序路径

静态时序分析检查所有时序路径,确保数据在时钟沿之间正确传输。时序路径包括输入到寄存器、寄存器到寄存器、寄存器到输出等。

2.2 建立时间检查

建立时间检查确保数据在时钟沿之前稳定到达寄存器,建立时间违规会导致数据无法正确捕获。

2.3 保持时间检查

保持时间检查确保数据在时钟沿之后稳定保持一定时间,保持时间违规会导致数据被下一个时钟沿覆盖。

三、PrimeTime的关键特性

3.1 多工艺角分析

PrimeTime在所有工艺角下分析时序,确保芯片在各种条件下都能正常工作。

3.2 片上波动分析

PrimeTime考虑芯片内部的工艺波动,进行统计静态时序分析。


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