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[源代码]数字通信同步技术的MATLAB与FPGA实现 帧同步技术的FPGA实现
资料介绍
以Altera公司的FPGA为开发平台，以MATLAB及Verilog HDL为开发工具，详细阐述数字通信同步技术的FPGA实现原理、结构、方法和仿真测试过程，并通过帧同步的工程实例分析FPGA实现过程中的具体技术细节。
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/.cmp.kpt | 1KB | 2019-05-16 17:45:36 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/logic_util_heursitic.dat | 9KB | 2019-05-16 17:45:32 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/RS232.(0).cnf.cdb | 2KB | 2019-05-16 17:45:16 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/RS232.(0).cnf.hdb | 1KB | 2019-05-16 17:45:16 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/RS232.(1).cnf.cdb | 3KB | 2019-05-01 10:04:22 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/RS232.(1).cnf.hdb | 1KB | 2019-05-01 10:04:22 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/RS232.(2).cnf.cdb | 3KB | 2019-05-01 10:04:22 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/RS232.(2).cnf.hdb | 1KB | 2019-05-01 10:04:22 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/RS232.(3).cnf.cdb | 4KB | 2019-05-01 10:04:22 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/RS232.(3).cnf.hdb | 1KB | 2019-05-01 10:04:22 |
| [源代码]数字通信同步技术的MATLAB与FPGA实现--Altera Verilog版 9 帧同步技术的FPGA实现/E9_1/db/RS232.asm.qmsg | 2KB | 2019-05-16 17:45:42 |
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