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加法器是产生数的和的装置的实验
资料介绍
加法器是产生数的和的装置。加数和被加数为输入,和数与进位为输出的装置为半加器。若加数、被加数与低位的进位数为输入,而和数与进位为输出则为全加器
部分文件列表
文件名 | 文件大小 | 修改时间 |
adder/adder/_info | 1KB | 2011-03-26 14:51:44 |
adder/adder16.asm.rpt | 7KB | 2011-03-26 14:09:26 |
adder/adder16.done | 1KB | 2011-03-26 14:10:02 |
adder/adder16.fit.rpt | 190KB | 2011-03-26 14:09:18 |
adder/adder16.fit.smsg | 1KB | 2011-03-26 14:09:16 |
adder/adder16.fit.summary | 1KB | 2011-03-26 14:09:16 |
adder/adder16.flow.rpt | 6KB | 2011-03-26 14:09:28 |
adder/adder16.map.rpt | 16KB | 2011-03-26 14:08:58 |
adder/adder16.map.summary | 1KB | 2011-03-26 14:08:58 |
adder/adder16.pin | 77KB | 2011-03-26 14:09:16 |
adder/adder16.pof | 2048KB | 2011-03-26 14:09:26 |
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资料:bitboy
全部评论(1)
2022-12-30 19:06:58杨义
资料不错