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加法器是产生数的和的装置的实验

更新时间：2020-08-19 22:04:31 大小：295K 上传用户：光源氏查看TA发布的资源 标签：加法器 下载积分：0分 评价赚积分 （如何评价?） 打赏 收藏 评论(1) 举报

资料介绍

加法器是产生数的和的装置。加数和被加数为输入，和数与进位为输出的装置为半加器。若加数、被加数与低位的进位数为输入，而和数与进位为输出则为全加器

部分文件列表

文件名文件大小修改时间
adder/adder/_info1KB2011-03-26 14:51:44
adder/adder16.asm.rpt7KB2011-03-26 14:09:26
adder/adder16.done1KB2011-03-26 14:10:02
adder/adder16.fit.rpt190KB2011-03-26 14:09:18
adder/adder16.fit.smsg1KB2011-03-26 14:09:16
adder/adder16.fit.summary1KB2011-03-26 14:09:16
adder/adder16.flow.rpt6KB2011-03-26 14:09:28
adder/adder16.map.rpt16KB2011-03-26 14:08:58
adder/adder16.map.summary1KB2011-03-26 14:08:58
adder/adder16.pin77KB2011-03-26 14:09:16
adder/adder16.pof2048KB2011-03-26 14:09:26
...

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全部评论(1)

  • 2022-12-30 19:06:58杨义

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