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一种高性能时钟晶体振荡器电路设计
资料介绍
设计了一种用于时钟芯片的Pierce晶体振荡器,通过对传统结构的改进,增加了振幅控制结构和输出频率校准电路,提高了输出频率、振幅的稳定性和输出频率的精度,降低了功耗.同时对电路的工作原理进行了理论分析,电路采用CSMC 0.5μm-5 V CMOS工艺实现,通过仿真结果验证,显示该设计达到了技术指标要求.
A Pierce crystal oscillator for RTC is presented. Amplitude regulation scheme is used to improve the stability of the output frequency and amplitude and to lower power consumption. The design increases the output frequency calibration circuit to improve the accuracy of the output frequency. Working principles are analyzed, and a practical circuit is implemented using CSMC 0. 5 μm-5 V CMOS process. The simulation results are presented.
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| 一种高性能时钟晶体振荡器电路设计.pdf | 265K |
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