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面向存算一体芯片的模拟计算阵列中电源管理电路设计与低dropout稳压器优化.docx

更新时间：2026-08-20 08:47:25 大小：39K 上传用户：他山之石可攻玉查看TA发布的资源 标签：存算一体芯片电源管理电路LDO稳压器模拟计算阵列电源噪声优化 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

面向存算一体芯片的模拟计算阵列中电源管理电路设计与低 dropout 稳压器优化

——从片内LDO到开关稳压器的模拟电源管理方案

引言

电源管理是存算一体芯片实现稳定、低噪声供电的关键。在存算一体芯片中，存算一体阵列、ADC/DAC、数字处理器和接口电路需要不同的电源电压和电流需求，且对电源噪声的敏感度不同。低压差稳压器（LDO）提供低噪声的电源，但效率较低；开关稳压器提供高效率的电源，但噪声较高。混合电源管理方案结合LDO和开关稳压器的优势，在噪声和效率之间取得平衡。本文系统分析面向存算一体芯片的模拟计算阵列中电源管理电路设计与LDO优化方案。

存算一体芯片的电源需求

电源域划分

存算一体芯片的电源域划分：

1. 模拟电源域：为存算一体阵列、ADC/DAC和模拟电路供电，电压约0.9V至1.2V，对噪声敏感。

2. 数字电源域：为数字处理器、控制逻辑和接口电路供电，电压约0.7V至1.0V，对噪声不敏感。

3. I/O电源域：为I/O接口电路供电，电压约1.2V至1.8V，对噪声的敏感度居中。

电源噪声要求

各电源域对噪声的要求：

1. 模拟电源域：电源噪声需小于1mVrms，确保模拟计算的精度。

2. 数字电源域：电源噪声可容忍10mVrms至50mVrms，数字电路对噪声的容限较高。

3. I/O电源域：电源噪声需小于5mVrms，确保信号质量。


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