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Cyclone4E FPGA设计4位并入串出移位寄存器Verilog逻辑源码Quartus工程文件.

更新时间：2021-08-23 10:37:58 大小：128K 上传用户：xzxbybd查看TA发布的资源 标签：cyclone4efpga移位寄存器verilog 下载积分：8分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

Cyclone4E FPGA设计4位并入串出移位寄存器Verilog逻辑源码Quartus工程文件.。Quartus11.0工程文件, FPGA型号为CYCLONE4E系列中的EP4CE6E22C8,可以做为你的学习设计参考。    

**----------------------------文件信息--------------------------

** 文件名称： reg_bc.v

** 创建日期：

** 功能描述：实现4位并入串出移位寄存器的功能

** 硬件平台：大西瓜logic^3 FPGA开发板

** 版权声明：本代码属个人知识产权,本代码仅供交流学习.

**---------------------------修改文件的相关信息----------------

** 修改人：

** 修改日期：

** 修改内容：

*******************************************************************************/

module reg_bc(clk,clr,din,dout);

input clk,clr; //输入时钟端，清零端（高电平有效）

input[3:0] din; //数据输入端

output dout; //数据输出端


reg[1:0] cnt;

reg[3:0] q;

reg dout;


always@(posedge clk) //时钟上升沿触发

begin

cnt<=cnt+1; //cnt自加1

if(clr) //判断清零信号是否有效

begin

q<=4'b0000; //q置0

end

else 

begin

if(cnt>0) //判断cnt是否大于0

begin       

image.png

部分文件列表

文件名大小
4位并入串出移位寄存器/
4位并入串出移位寄存器/db/
4位并入串出移位寄存器/db/logic_util_heursitic.dat
4位并入串出移位寄存器/db/prev_cmp_reg_bc.map.qmsg4KB
4位并入串出移位寄存器/db/prev_cmp_reg_bc.qmsg3KB
4位并入串出移位寄存器/db/reg_bc.(0).cnf.cdb2KB
4位并入串出移位寄存器/db/reg_bc.(0).cnf.hdb1KB
4位并入串出移位寄存器/db/reg_bc.cbx.xml
4位并入串出移位寄存器/db/reg_bc.cmp.rdb5KB
4位并入串出移位寄存器/db/reg_bc.cmp_merge.kpt
4位并入串出移位寄存器/db/reg_bc.db_info
...

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