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嵌入式系统PCB设计——电源完整性与信号完整性.docx
资料介绍
21 嵌入式系统PCB设计——电源完整性与信号完整性
一、引言
在嵌入式系统设计中，PCB早已超越了简单的"连通性"任务，它直接决定了系统的稳定性、性能和电磁兼容性。当 MCU 主频突破数百 MHz、DDR 接口速率逼近 1600MT/s、USB 高速差分对需要严格控制 50Ω 阻抗时，PCB 已不再是逻辑的被动载体，而成为信号完整性（SI）、电源完整性（PI）与电磁兼容性（EMC）的主动参与者。一个在 Keil 中完美运行的固件，在 PCB 上可能因电源平面分割导致 ADC 采样漂移；一段在示波器上波形干净的 UART 通信，在整机中可能因共模电流耦合引发误码率骤升。
二、电源分配网络设计
电源完整性（PI）常被误解为"多加几个电容"。事实上，PDN 是一个由 VRM（电压调节模块）、PCB 平面、过孔、封装引线、芯片内部 bond wire 构成的分布式 LCR 网络。其核心目标是在负载电流瞬变发生时，将供电电压波动抑制在芯片允许范围内。
PDN 阻抗目标：以 STM32H743 为例，其 VDD 允许纹波 ±50mV，最大动态电流 1.2A，上升时间 1ns。根据公式 ΔV = L × di/dt，若 PCB 电源路径电感为 10nH，则 ΔV 可达 12V。因此必须将 PDN 阻抗控制在 42mΩ 以下。这一目标要求在 DC 到 500MHz 范围内，PDN 阻抗模值始终低于此值。
去耦电容策略：电容选型需遵循自谐振频率覆盖原则。100μF 钽电容覆盖 100kHz 频段，10μF X7R 陶瓷电容覆盖 1MHz，1μF 电容覆盖 10MHz，0.1μF 电容覆盖 100MHz，1000pF NPO 电容覆盖 1GHz。每个 VDD 引脚旁应直接焊接 0.1μF 电容，焊盘中心距引脚不超过 2mm。
电源平面分割：在混合信号系统中，模拟电源与数字电源必须使用独立的 LDO 或滤波网络产生，并在 PCB 上用磁珠或 0Ω 电阻进行单点连接。功率地（PGND）与模拟地（AGND）在物理上分割，最终在电源输入接口附近单点连接，防止数字噪声通过电源平面污染模拟电路。
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