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VHDL语言参考
资料介绍
VHDL是一种编程语言，专为描述数字系统的行为而设计和优化。
VHDL具有许多适用于描述电子元件行为的功能，从简单的逻辑门到完整的微处理器和定制芯片。 VHDL的特性允许电路行为的电气方面（例如信号的上升和下降时间，通过门的延迟和功能操作）精确描述。 然后，生成的VHDL仿真模型可用作较大电路中的构建块（使用原理图，框图或系统级VHDL描述）以进行仿真。
VHDL也是一种通用编程语言：正如高级编程语言允许将复杂的设计概念表示为计算机程序一样，VHDL允许将复杂电子电路的行为捕获到用于自动电路合成或系统的设计系统中 模拟。 与Pascal，C和C ++一样，VHDL包含对结构化设计技术有用的功能，并提供丰富的控制和数据表示功能。 与这些其他编程语言不同，VHDL提供了允许描述并发事件的功能。 这很重要，因为使用VHDL描述的硬件在其操作中本质上是并发的
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| 1554904210TR0114_VHDL_Language_Reference.pdf | 654K |
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