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基于fpga的循环码编码器verilog实现实验
资料介绍
循环码编码器verilog实现，里面包含有源程序和仿真图。
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| 循环码编码器verilog实现/循环码编码器/1.bmp | 1049KB | 2008-02-17 02:33:58 |
| 循环码编码器verilog实现/循环码编码器/2.bmp | 1041KB | 2008-02-17 02:54:42 |
| 循环码编码器verilog实现/循环码编码器/crc_3.txt | 3KB | 2008-02-17 02:48:06 |
| 循环码编码器verilog实现/循环码编码器/crc_3_testbench.txt | 1KB | 2008-02-17 02:49:18 |
| 循环码编码器verilog实现/循环码编码器/crc_3.v | 3KB | 2008-02-17 02:46:50 |
| 循环码编码器verilog实现/循环码编码器/crc_3_test.v | 1KB | 2008-02-17 01:58:30 |
| 循环码编码器verilog实现/循环码编码器 | 1KB | 2008-03-02 19:16:30 |
| 循环码编码器verilog实现 | 1KB | 2008-03-02 19:16:30 |
| www.pudn.com.txt | 1KB | 2007-06-05 03:14:22 |
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2023-05-05 23:05:10杨义
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